Verilog 首页 › 论坛 › FPGA › 开发语言 › Verilog 此版块包含 20个话题 和 28个回复,最后由vacuum 更新于 6月、 3周前 。 Log In Register Lost Password 正在查看 22 话题: 1-20 (共 22 个话题) 1 2 → 话题 参与人 帖子 最后发表 老师,这个电路可以详细讲解一下吗? 由: 殷鹏程 发表 Views: 944 在: 模拟 8 10 11月、 1周前 wanglong30 Verilog 语言编程与FPGA应用设计教材 由: tzhuang 发表 Views: 762 在: FPGA 2 2 1年、 2月前 张洪泉 关于延迟赋值语句问题 由: tzhuang 发表 Views: 330 1 1 1年、 1月前 tzhuang always(*) case 由: vacuum 发表 Views: 143 2 3 6月、 3周前 vacuum 关于网络协议基础接收 udp_receive模块中IP首部状态机问题 由: 陈家宁200907 发表 Views: 207 1 1 10月前 陈家宁200907 关于flash课程中phy模块问题 由: 陈家宁200907 发表 Views: 245 2 2 10月前 wx3EZTPN7NAL 关于状态机状态参数定义道问题 由: 陈家宁200907 发表 Views: 227 2 3 11月、 2周前 Yvonne 【分享】verilog function的使用 由: 图图 发表 Views: 285 2 2 1年前 tzhuang 【分享】verilog ROM参数化赋初值 由: 图图 发表 Views: 365 1 1 1年、 1月前 图图 请老师帮忙提供个思路做64位比较器 由: 06班级于海松 发表 Views: 527 3 8 1年、 1月前 tzhuang 做sram实验遇到的问题 由: 06班级于海松 发表 Views: 409 2 2 1年、 1月前 tzhuang 请问老师64个数的比较器什么样的思路设计 由: 06班级于海松 发表 Views: 318 2 2 1年、 1月前 Yvonne Verilog 向量位增量访问 由: tzhuang 发表 Views: 330 2 2 1年、 1月前 201008班_刘璇 在出现进位时Verilog运算注意事项 由: tzhuang 发表 Views: 215 1 1 1年、 2月前 tzhuang 哪里查看软件有哪些函数和对应的功能呢 由: 小强 发表 Views: 298 2 4 1年、 2月前 Yvonne verilog 中标量与向量 由: tzhuang 发表 Views: 244 1 2 1年、 2月前 tzhuang 在verilog 语言中 !~ not的区别 由: tzhuang 发表 Views: 457 2 3 1年、 2月前 tzhuang 2进制有符号数问题 由: tzhuang 发表 Views: 278 1 2 1年、 3月前 tzhuang 50M的系统时钟,计时1s所需二进制位数的问题 由: 肖桂鸿 发表 Views: 335 3 4 1年、 3月前 张洪泉 reg 型变量赋值问题 由: tzhuang 发表 Views: 237 1 2 1年、 3月前 tzhuang 200K时钟1秒的计数器是不是应该计数200000次 由: 肖水平 发表 Views: 241 2 2 1年、 3月前 张洪泉 梅利型状态机改成摩尔型注意的地方 由: 张洪泉 发表 Views: 269 1 1 1年、 3月前 张洪泉 Log In Register Lost Password 正在查看 22 话题: 1-20 (共 22 个话题) 1 2 → 您需要先登录才可以创建新话题。 登录 用户名: 密码: 保持登录状态 登录