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实际上，在Vivado软件中，调试（debug）还可以使用Tcl命令，直接修改*.xdc文件，和添加ILA（ Integrated Logic Analyzer） IP核完成，之后会在Vivado软件调试工具的使用进阶中介绍。
ISE中的调试工具为Chipscope，在Vivado中不再使用Chipscope，而是使用ILA替代了Chipscope相关功能。
本教程初步介绍调试工具ILA（Integrated Logic Analyzer），集成内部逻辑分析仪的使用。
乘法器在数学运算中应用及其广泛，在当代的计算机系统，数字信号处理系统等都是必备处理部件。因此本节内容介绍二进制乘法器的原理及设计实现。
上一篇文章Vivado软件的使用中简单介绍了创建，…
由于计算机技术的飞速发展带动了网络的发展，在上个世…
累加器应用非常广泛，特别是在数学运算，数据平滑，平均值，中值等领域有着广泛应用。
全减器采用补码的方式实现，2进制补码对变量取反加一。取补码后，原来的减法就变成加法。
在CPU的ALU的设计中，全加器是ALU的重要组件，因此这部分内容会单独拿出来讲解。
目前Intel公司接手Altera后继续维护这个功能，而且有所加强。而自顶向下的设计方法在Quartus的图形输入的的支持下更是特点突出，
在FPGA EDA综合工具中，Quartus II的图形设计界面是非常友好的，无论是早期MAX+PLUSS II还是现在的Quartus Prime Lite版本始终保留了非常好的图形设计界面用户体验也非常好，
$strobe系统任务和$display 系统任务的语法基本上是相同的。$strobe 也是在控制台窗口下，打印输出。 它是在当前的时间点结束时执行，而不是解析到当前的$strobe 立即执行。
在前面的几节课程中， 我们介绍了$display，$monitor 系统任务，本文介绍的$strobe任务也是激励文件中经常使用的系统任务，它可以很好的帮助我们观察运行结果，定位运行中出现的问题。
自底向上的优点是每个小的子模块都可得到充分验证，在组装成复杂模块时可以减少验证时间。
在中小型的工程设计中，由于工程相对简单，合作的团队或个人很少，有的工程可能就由一个人完成。
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中断工程将使用entry.S文件，该文件用于调用中断入口函数。 在主程序的初始化函数中，trap_entry的地址将分配给RISCV CPU控制和状态寄存器（control and status register，CSR）mtvec。
在此使用新的头文件fii_irq.h。 除此之外，还将介绍entry.S和main.c。 其余的头文件与之前的工程(见RISC-V C语言编程2（1）数码管工程)相同。
RISCV_timer_irq避免了复杂的中断发生，仅实现机器模式计时器中断。这里通过一个每隔250毫秒点亮LED计数器和通过串口打印输出计数值的例子，来说明如何使用定时器中断来控制精准的时间。
通常，一次只允许一个中断，其他中断应等待直到其完成。 有时，在中断中可能会再次发生中断，这称为中断嵌套。
中断是临时的，除非中断指示致命错误，否则在中断处理程序完成后，处理器将恢复正常活动。
中断是处理器对需要软件注意的事件的响应。中断条件将警告处理器，并用作对处理器的请求，在允许后，中断当前正在执行的代码，以便可以及时处理该事件。
在深入研究工程之前，先简单介绍一下中断。中断是指CPU在正常运行程序时，由于内部/外部事件引起CPU 中断当前运行的程序，而转到为内部/外部事件的服务程序中去， 当服务完毕后，又返回执行cpu的正常程序。
