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状态机几乎无处不在,特别是在软件设计,数字时序电路设计,FPGA,IC设计等领域被广泛使用。如图4,就是一个典型数字时序电路状态机的模型。在数字时序电路中,由于触发器的翻转是受时钟和输入控制,触发器的输出可以很好的表达状态机的状态,所以许多日常生活中的状态都可以用时序电路描述,我们称这种行为为时序电路状态机建模。